问题描述：
[单选]
基于EDA软件的FPGA / CPLD 设计流程为：（）。
A．原理图/HDL 文本输入→功能仿真→ 综合→ 适配→ 时序仿真→ 编程下载→测试。
B．原理图/HDL 文本输入→时序仿真→ 综合→ 适配→ 功能仿真→ 编程下载→测试。
C．原理图/HDL 文本输入→功能仿真→ 适配→ 综合→ 时序仿真→ 编程下载→测试。
D．原理图/HDL 文本输入→功能仿真→ 时序仿真→ 综合→ 适配→ 编程下载→测试。
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