问题描述：
[单选]
以下代码实现了一个3-8译码器。module test（clk，reset，en，in，out）;iput clk，reset，en，in;output【3:0】 out;reg【3:0】 out;always @（posedge clk）begin if（reset） out<=4 ’h0;else if（en） out<={out，in};endendmodule
A．对
B．错
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