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[单选]VerilogHDL支持循环语句。（）
[单选]ASIC是专用集成电路的缩写。（）
[单选]VerilogHDL中整数型常量是不可以综合的。（）
[单选]仿真分为功能仿真和时序仿真。（）
[单选]IP是IntellectualProperty的缩写。（）
[单选]用状态机进行设计具有速度快、结构简单、可靠性高等优点。（）
[单选]数字设计流程中采用原理图方式适合描述电路的连接关系核接口关系。（）
[单选]目前在数字系统的设计中，主要采用Bottom-UP设计为主。（）
[单选]不考虑信号时延等因素的仿真称为功能仿真。（）
[单选]PLD器件内部主要由各种逻辑功能部件和可编程开关构成。（）
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